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复杂SoC设计中的功率管理 (下) |
| 发布时间:2005年9月7日 点击次数:458 |
| 来源:电子设计应用 作者:Synopsys公司 Jim Flynn Brand |
5中,根据静态与动态功率以及这些技术所应用的设计抽象层次,对各项功率优化技术进行了分类。使用这些方法中的哪项或哪几项要取决于设计目标。将这些方法结合到设计流程中,就形成了一种集成式的功率管理设计策略。
图用于设计流程(从上至下)不同阶段的功率优化技术,以及它们如何影响静态或动态功率(从左至右)
图 在综合过程中的功率优化
图添加了控制点的门控时钟电路
8
Power Compiler (DSP 30%
( Astro CTS( CTS
CTS ASIC
(
Synopsys
Vth one-pass Power Compiler
RTL RTL 5~15% Power Compiler RTL Power Compiler (1''b1) Power Compiler Design Compiler
"If-Else"
"Case" "For" RTL
(technology mapping)
Power Compiler
SoC ARM 240MHz 8 120MHz
Synopsys
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