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恰当选择DSP是网络多媒体设计成功关键 |
| 发布时间:2006年7月12日 点击次数:761 |
| 来源:EDN电子设计技术 作者:David Katz和Rick Gentile美国模拟器件公司 |
为网络多媒体应用选择一个恰当数字信号处理器(DSP)是一项很复杂的工作。首先,必须在当前和近期业界接口的需求环境下对处理器的内核体系结构和外围设备配置进行透彻的分析。其次,为了防止出现带宽瓶颈问题,了解多媒体数据(例如:视频、图像、音频和分组数据)如何流过一个基于DSP的系统是至关重要的。另外,了解造成最低标准临界实现和鲁棒性解决方案之间的差别的各种系统属性(包括DMA和存储器访问)也是很有帮助的。
系统数据流 由于许多视频压缩算法一次只处理一个数据块,例如16×16像素“宏块”,每个数据块可以根据需要从外部存储器调入。某些算法需要多个图象或视频帧来完成要求的处理,从而导致 DSP片内存储器和片外存储器之间需要多次的双向数据传递。通常,在一个输入缓冲器将数据流送入SDRAM的同时,DSP内核正在压缩来自前一个缓冲器送来的数据。这些缓冲器很可能处在SDRAM中的不同页。这会导致浪费等待时间,除非DSP能够在同一时间打开不止一个SDRAM页。 安全系统可能出现的情况是高数据传送速率的一个实例,其中的数据传送一定发生在多个子系统之间以便支持网络多媒体应用;在上述实例当中至少存在5组数据同时传送。在考虑总的数据流时,单单确认通过系统的总字节流量没超过DSP的理论片内带宽(总线速度乘以总线宽度)是不够的。 例如,对于以高速内核时钟速率运行的部分来说,内核处理器和外设之间总线通常以133 MHz速率运行。对32位总线来说,数据吞吐量在理想情况下应该接近532 Mbps。而实际上,该理想峰值仅当只有一个传送有效而且没有其它传送请求时才能达到。由于应用中会连接具体的外设,而它们中的每一个都必然争夺DSP的内部带宽资源。 系统设计师通常允许仲裁延时,所以通常假定只有50%的内带宽可利用。 显而易见,适合NMD应用的DSP必须要有一个独立于内核处理器的直接存储器存取(DMA)引擎。也就是说,可用的DMA通道总数必须能支持各式各样的外设。另外,在像MPEG或JPEG处理这样的计算密集型算法中,一个灵活的DMA控制器能省去额外的数据通路。例如,可以用各种不同的方式在存储器系统和外围设备之间传送数据。另外,带二维DMA功能的DSP能简化宏块进出外部接存储器的传送,从而允许数据控制成为数据实际传送的一部分。这对色彩空间元素的交叉和解交叉来说是一种很方便的功能。为最大限度地发挥DMA的优势,需要一个带优先级的中断控制器,以保证当待处理的数据准备好或处理过的数据已成功传送出去时,才中断DSP内核。 到现在应该清楚的是,为网络多媒体应用选择处理器是一项重要而且复杂的任务。但是,只要在最初的DSP选择阶段考虑系统级的各种问题,设计工程师不仅能保证成功地处理现有的应用数据流,而且还能保证现有的处理器余量和外围设备连接,随着网络和多媒体标准的发展能够直接升级。 一个嵌入式网络安全系统应用示出了处理器必须管理的数据流的复杂性。为了支持所有的子系统高效地运行,不仅高速DSP内核时钟速率很关键,还必须有灵活的外围设备并要执行专用MCU才能完成的控制代码。 |
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