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Xilinx面向数字通信优化DSP工具 |
| 发布时间:2005年5月25日 点击次数:25 |
| 来源:中电网 作者: |
System Generator for DSP v7.1工具和XtremeDSP开发套件可一起用于设计和实现使用赛灵思公司最近推出的多种3G和4G基站无线算法（包括RACH、searcher、HSDPA、DUC和DDC）的系统。 “将Virtex-4 XtremeDSP开发套件与System Generator for DSP工具结合使用,设计人员可拥有一个开发和验证高性能数字通信DSP系统的极佳开发环境,”赛灵思公司DSP部营销总监David Squires说。“通过并行机制,我们的DSP器件提供了出众的高性能,因此是无线和其它数字通信应用信号处理路径中的理想协处理器。” 赛灵思Virtex-4 SX系列中的XtremeDSP逻辑片具备500 MHz的吞吐能力。System Generator for DSP v7.1工具使设计人员可充分利用这一强大能力。 此外,System Generator for DSP v7.1提供了一个全面的设计环境,可支持： 系统建模 - 结合Simulink支持信号流建模以及通过与赛灵思嵌入式开发套件（EDK）集成支持控制路径建模。这可促成在单个设计环境中完成整个系统的设计和建模,从而简化设计流程。 算法开发 - 利用MATLAB和System Generator的MATLAB接口以及Accelchip工具可以容易地实现数学功能。Accelchip工具允许导入宏代码（m-code）和定制AccelWare IP内核来实现矩阵乘法功能和线性代数功能。 自动硬件或位流生成 - 通过与Xilinx ISE 7.1i 和 XST 工具的紧密耦合。不太熟悉FPGA的DSP设计人员只需要点击按钮仍然可以实现高度优化的设计。硬件设计人员还可以通过黑盒子功能将HDL模块导入System Generator for DSP工具。 设计验证和调试 – 当在设计流程中使用XtremeDSP开发套件硬件以及使用Xilinx Chipscope Pro调试软件工具时。Chipscope Pro工具可使设计人员观察到内部结点,从而使设计调试更快、更容易。 这一集成化设计流程使没有或很少有HDL设计经验的设计人员可以在很高的设计抽象层次上工作,并且可以在数天时间内实现从初始概念到硬件验证的整个过程。System Generator for DSP v7.1支持所有主流Xilinx DSP 系列产品,包括最近发布的带有 325MHz 嵌入式 18x18乘法器的Spartan-3E 系列产品。 新的XtremeDSP 开发套件是赛灵思与FPGA计算解决方案厂商Nallatech共同开发的。它包括一个集成了多达192个XtremeDSP逻辑片的Virtex-4 SX35器件。每个逻辑片由一个18 x 18乘法器和一个48位加法器组成,并且可在每个时钟周期动态配置,从而提供了巨大的灵活性和优化能力。 独特的高带宽硬件协同仿真功能允许设计人员将仿真速度提高几个量级,还可以同时在硬件中对设计进行验证。XtremeDSP开发套件包括一个模拟卡。卡上有一个双通道14位105 MSPS A/D转换器和一个14位160 MSPS D/A转换器。因此它对于软件无线电这样的高性能无线应用是一个理想的开发平台。 |
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