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稳定的PLL合成高速时钟

发布时间:2005年12月16日 点击次数:281
来源:EDN电子设计技术   作者:
 
       一些应用需要时钟在长期(频率稳定性)和短期(相位噪声和抖动)参数方面都具有良好稳定性,对于这类应用来说,设计者常常需要专用一个晶体振荡器。如果工作频率非标准,这将意味着要进行定制设计,而且需要较长的订货交付时间。ON Semiconductor公司宣称,他们生产的NB4N507A芯片在保持抖动性能的同时可以取代很多这类晶体振荡器。NB4N507A是集成式PLL(锁相环,phase-lock-loop),它可以由低价的参考晶振产生50 MHz~200 MHz的频率。它的最大RMS抖动值小于10 ps,低于其他相关解决方案的一半(据ON的说法)。公司使用完全差分双极技术设计了这个芯片,它能产生占空比为50%±2%的正射极耦合逻辑(PECL,positive emitter-coupled logic)输出,并且达到100 ppm (百万分之一)的稳定性。芯片需要一个晶振以提供10 MHz~27 MHz范围内的参考输入,并在输出端产生该参考输入整数倍的输出。此部件适合用于SONET以及其他通信应用,它能由19.44 MHz的晶振,经过8倍倍频后获得精确的155.52 MHz时钟。它还具有超过10kHz的环带宽,可以跟踪任何达到10 kHz的调制输入——因此,设计者可以将它视为一台高频率的压控晶体振荡器(VCXO,voltage-controlled crystal oscillator)使用。芯片售价为1.50美元。
  网址:www.onsemi.com

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