楼 主:sz20120406 2012年4月11日12:58

 Virtex-II ProTM平台FPGA的主要特性和功能
Virtex-II ProTM平台FPGA的主要特性和功能
Rocket I/OTM 收发器
Virtex-II ProTM 器件提供了高达16个千兆位并串和串并收发器，可以支持不同的高速串行标准，如Gigabit Ethernet、 Fiber Channel、 Infiniband、 Serial ATA、 RapidIO、 3GIO、 Aurora、和XAUI。其通道绑定功能可以结合多个通道提供高于3.125Gb/s的数据传输速率。Rocket I/OTM收发器支持物理媒体附加子层（串行化器、并串转换器、时钟和数据恢复、发送/接收缓冲器）和物理编码子层（8B/10B编码器/解码器和弹性缓冲器）。
PowerPCTM 405 处理器
Virtex-II ProTM 器件可提供多达4个高性能、低功耗、高速IBM PowerPCTM 405微处理器核心。在器件中集成PowerPC核心是利用IP-Immersion架构完成的。IP-Immersion架构允许硬核心扩散分布到平台 FPGA结构中的任意位置，同时还可保持与周围逻辑阵列间的无与伦比的连接能力。利用处理器局部总线（PLB）和采用CoreConnect互连总线片上总线架构的外设总线，处理器可以控制和管理多种外设资源。运行在300+MHz时钟下，能够提供420+ Dhrystone MIPS性能的PowerPCTM 405微处理器核心提供了众多下一代嵌入式系统所需要的处理能力。
18位×18位乘法器
Virtex-II ProTM 器件提供多达216个嵌入式18位×18位二进制补码乘法器。这些嵌入式乘法器为实现18位× 18位带符号乘法提供了一个快速高效的方法。一个乘法器模块与一个SelectRAM存储器块相关联。乘法器模块针对利用块SelectRAM一个端口的数据进行了优化。利用这些乘法器，读取/相乘/累加操作和DSP滤波器结构变得异常快速和高效率。SelectRAM存储器和乘法器资源都连接到四个交换矩阵以实现与通用布线资源的连接。 
全局时钟
高频率设计需要低畸变的高级时钟分配。在多数大密度设计中通常需要大量全局时钟。所有的Virtex-II ProTM器件都包含16个全局时钟缓冲器，支持16个全局时钟区域。这些时钟域支持进行更高水平的逻辑集成，并免除了进行复杂的时钟树分析的需要。16 个时钟缓冲器还是“无毛刺”同步2:1复用器。这些复用器可以在任意时间在两个异步（或同步）时钟间进行切换。
数字时钟管理器（DCM）
Virtex-II ProTM器件提供多达8个数字时钟管理器（DCM）。每一个DCM都支持零延迟时钟缓冲、精确相位移动和频率合成控制。
DCM还支持对其输出时钟进行90°、180°和270°的相移。异常灵活的频率合成可提供输入时钟频率分数倍数或整数倍数的时钟输出频率。
片上存储器（OCM）控制器
OCM控制器在FPGA中的块RAM和嵌入式PowerPCTM405处理器核心执行单元间提供一个专用的接口。PowerPCTM核心上的OCM信号旨在提供对固定大小的指令和数据存储器空间的超快速访问。
OCM接口具有与缓存同样的访问时间。由于缓存为来自其它存储器资源的缓冲代码而保留，因此OCM减小了缓存的更新频率。双口块RAM可做为OCM在处理器核心和FPGA结构间实现一个高效率的共享式高速缓存存储器接口。
Block SelectRAM (BRAM) 资源
除了分布式 Select RAM存储器（可级联16位×1位）以外，Virtex-II ProTM器件还包含了大量18kbit的块状SelectRAM（BRAM）。BRAM存储器是真正双口（True Dual-Port）RAM，在器件内提供了大量快速分散的存储器块。BRAM存储器的总量随着Virtex-II Pro器件的规模而增长（高达3.8Mbit）。18Kb每块的BRAM块是可级联的，从而可支持更深和更宽的存储器设计，同时通过专门的布线资源使得时序代价极小。
单端 SelectI/O 资源
对更复杂系统的需求、时钟速率的提高和对 更小芯片到芯片间延迟的要求推动了更高性能I/O的发展。Virtex-II ProTM FPGA系列包括了高度可配置的高性能的可支持范围广泛的I/O标准的单端SelectI/O模块。Virtex-II ProTM SelectI/O模块支持下列单端I/O标准：
GTL+、HSTL (I, II, III, 和 IV)、 SSTL3 (I, 和 II)、 SSTL2 (I 和 II) 、 LVTTL、 LVCMOS(15, 18, 25, 和 33)、PCI33_3、 PCI66_3、 PCIX 和 GTL。 
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