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→在verilog HDL中,wire和reg的使用方法有什么[lzh08_laogu]
*第18782篇: 在verilog HDL中,wire和reg的使用方法有什么区别?
楼 主:
lzh08_laogu
2004年1月23日04:39
在verilog HDL中,wire和reg的使用方法有什么区别?
在verilog HDL中,wire和reg的使用方法有什么区别?
第
2
楼:
seanwu
2004年1月24日21:18
最基本的概念, 编个程序编译一下就知道了
最基本的概念, 编个程序编译一下就知道了
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大虾们,请看看!!!!!!!!!!!!!
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