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 按序存储连续输入的16个16位数的问题
我要用verilog做个程序，里面有个模块是连续采集16个16位数据，按顺序分别存储在16个寄存器中。用的是max plus ii。max plus ii 不支持[15:0]DATA_REG[1:16]的定义，要怎么才能做到把按顺序输入的16个16位数据分别存储呢？数据是用一个for(k=0;k  <16;k=k+1)语句按顺序发送的。


发表时间:2006年5月22日0:32:28