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* 4496: 硬件:老古：在您的epm7128管脚图中定义了两个CLK信号，我有点怀疑，是不是一个为CLK,一个为ALE信号？请指点.
老古
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一个是输入时钟，22。1184Mhz，clk是输出时钟，给pci总线用的。
发表时间:2002年1月8日16:47:00
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*树形目录 只列出部分跟帖的标题以及简单的摘要信息 该主题的部分跟帖如下:
4499.[详细]输出时钟的频率是多少，它是怎么得出来的，另外它对应的管脚是第21脚吗？摘要:......(无内容)
－ [explore][981次] 2002年1月8日
4505.[详细]输出时钟和输入时钟是一样的。22。1184Mhz摘要:......(无内容)
－ [老古][964次] 2002年1月8日