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→我估计是非同步操作引起的问题。
需要修改你的代码。
注意
* 41040: 请大家为我揭开一个Verilog-HDL的谜团!谢谢!
guest
guest发表的帖子
我估计是非同步操作引起的问题。
需要修改你的代码。
注意多时钟同步的问题。
发表时间:2003年8月28日17:54:12
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本主题共有
3
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>>>>>该主题的所有内容[3]条
*树形目录 只列出部分跟帖的标题以及简单的摘要信息 该主题的部分跟帖如下:
[上一篇帖子]:
我觉得大家都说得不对! /P P 主要原因在于当正弦波时判决的相位不固定 而且有可能做记
[下一篇帖子]:
问一问这个公司吧: 北京鑫富瑞普电子有限公司。 它们好象在这方面做得挺好的。