No.90028
作者：zbh0727
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标题：zbh0727:急求各位高手帮忙解决一个问题，郁闷了小弟很多天！谢谢!
摘要：No.90028急求各位高手帮忙解决一个问题，郁闷了小弟很多天！谢谢! LIBRARY IEEE;
USE IEEE.STD_LOGIC_1164.ALL;
USE IEEE.STD_LOGIC_UNSIGNED.ALL;
USE IEEE.STD_LOGIC_ARITH.ALL;
ENTITY DIGITAL1 IS --数字频率计整程序
PORT(CON_GATE,STD,BEICE,Z_RST:IN STD_LOGIC; --beice为被测信号，con_gate为门控信号
FREQUENCE:OUT STD_LOGIC_VECTOR(31 DOWNTO 0);--频率输出
SLJI:OUT INTEGER RANGE 0 TO 15); --频率数量级
END ENTITY;
ARCHITECTURE BHV OF DIGITAL1 IS
COMPONENT COUNT IS --计数模块元件
PORT(STDF,BCF,GATE:IN STD_LOGIC;
BOUT,SOUT:OUT STD_LOGIC_VECTOR(31 DOWNTO 0));
END COMPONENT;
COMPONENT DIV1 IS --除法模块元件
PORT (CLK,RST:IN STD_LOGIC;
BEI,CHU:IN STD_LOGIC_VECTOR(31 DOWNTO 0);--被除数，除数
SHANG:OUT STD_LOGIC_VECTOR(31 DOWNTO 0);--商
DIAN:OUT INTEGER ......
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