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No.59021
作者：sz20120406
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标题：sz20120406:关于FPGA实现设计
摘要：No.59021关于FPGA实现设计关于FPGA实现设计
（1）单工条件下的实现
用两块FPGA分别实现编码器和解码器。按前面的编解码原理，编码器接收子站8位信息和1位同步，输出8字节×8位帧结构编码作远程传输，解码器收到帧结构编码，输出8位信息和1位同步给基站。（在实际应用中，子基站两MPU还要加入通常的累加和检错或偶校验检错。因不属编解码内容，不作讨论。）

为检验电路设计，假设输入信号为11001010，编码输出的帧结构为表4。
表4
帧头1        1        1        0        1        0        1        0        0        =D4
帧头2        1        1        0        1        0        1        0        0        =D4
第3字节        0        0        0        0        0        1        1        1        =07
第4字节        1        1        1        1        1        0        0        0        =FB
第5字节        0        0        0        0        0        1        1        1        =07
第6字节        1        1        1        1        1        0        1        0        =FA
第7字节        0        0        0        0        0        1        0        1        =05
第8字节        1        0        1       ......

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