No.59017
作者：sz20120406
邮件：383959053@qq.com
ID：130937
登陆：2次
文章数：69篇
最后登陆IP：111.222.53.176
最后登陆：2012/5/2 17:40:27
注册：2012/4/11 12:44:55
财富：101
发帖时间：2012/4/11 13:00:11
发贴者IP：183.14.195.147
标题：sz20120406:多目标信号间高精度高可靠性延时的设计与实现
摘要：No.59017多目标信号间高精度高可靠性延时的设计与实现 多目标信号间高精度高可靠性延时的设计与实现
多目标信号各目标回波之间的距离体现在回波之间的时延上，多目标信号产生器的各回波之间的时延由FPGA产生。DSP将计算出的回波信号数据存储在双口RAM中，然后由双DA读出数据进行数模转换输出模拟的回波信号。FPGA需要为数据转换提供时序控制信号、读数据时的地址信号及双DA的转换时钟信号等；将时钟信号经过FPGA进行精确的延时，延时后的信号作为双口RAM读出数据时地址发生器的时钟信号，将延时后的信号与DSP提供给双DA的初始化信号相与后提供给双DA作为数据转换时钟。
产生各目标回波间时延有多种方法，如采用分立元件实现，但这种方法存在电路复杂、可靠性差等缺点。本文采用FPGA器件实现回波间高精度的延时具有电路简单、功能强、修改方便和可靠性高等优点。VIRTEX-II系列FPGA器件有4～12个数字时钟管理器DCM，每个DCM都提供了应用范围广、功能强大的时钟管理功能。如时钟去时滞、频率合成及移相等。它利用延时锁定环DLL，消除时钟焊盘和内部时钟引脚间的摆动，同时它还提供多种时钟控制技术，实现时钟周期内任意位置的精确相位控制，非常适合时序微调应用，对设置和保持时序对准非常关键。
DCM相移具有可变相移和固定相移两种模式。设计中，由于延时量由用户外部输入提供，故采用可变相移模式。在可变相移模式中，用户可以动态地反复将相位向前或向后移动输入时钟周期的1／256。可变相移模式中，相移控制针如表1所示。当PSEN信号有效，则相移值可以由与相移时钟PSCLK同步的PSINCDEC信号决定动态地增加或减少，本设计中相移时钟由输入时钟提供。PSDONE输出信号与相移时钟同步，它输出一个相移时钟周期的高电平表示相移已经完成，同时表示一个新的相移可以开始。输入时钟经过DCM移相电路移相后，得到所需延时之后的时钟输出。将该输出时钟作为双口RAM读出数据时地址发生器•的触发时钟及双DA进行数据转换的时钟输入，便可以实现回波信号的精确延时。 表1 相移控制针
控制针 方 向 功 能
PSINCDEC 输入 相增 ......
>>返回讨论的主题
| 
导航: 老古网→ 老古论坛→XMOS公共讨论区→XMOS开源项目区→单片机程序设计→嵌入式系统→广告区域→