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| 1.半整数分频的VHDL程序VHDL实例 简介:想出了一个半整数分频的VHDL语言描述 其实很多问题只要你耐心，也是比较容易的 写出来与大家共享，共同讨论，半整数分频当然还有其他的方法 我认为这种看起来蛮简单的 & ...... | 2006年7月28日 | 1456 |
| 2.[转载]透视 FPGA 的安全性 简介:作者:Vaughan Price 来源:电子设计应用 今天的设计人员已经在许多不同的领域中选择FPGA作为首选的解决方案。这些FPGA器件早已超越了原本作为原型设计工具的范畴，逐渐用于生产应用中，尤其是消费电子和汽车电子等领域。据Gartner Dataquest市场研究公司指出，FPGA器件在汽车应用中的使用规模从2002到2005年增加约七倍。 这个增长在很大程度上是来自于FPGA本身的 ...... | 2006年7月28日 | 1016 |
| 3.[转载]FPGA器件在嵌入式系统中的配置方式的探讨 简介: 摘要：通过说明FPGA的各种配置方式及各种配置文件的使用，重点探讨了在嵌入式系统中使用FPGA的软硬件设计。使用微处理器在线配置FPGA时，需要将存储在Flash中的配置文件，通过微处理器的I/O口存储到FPGA的数据存储器（SRAM）。文中详述了如何利用FPGA的被动串行方式（PS）配置方式，和根据配置时序实现嵌入式系统中FPGA的配置电路和相应的应用软件的过程。 关键词：嵌入式系统，FPG ...... | 2006年7月28日 | 1300 |
| 4.IC封装相关的一些基础材料 简介: 液态封装树酯 液态封装树酯具有可靠性佳、内应力极低、颗粒极细小等特性，用于涂布于芯片四周以保护组件。常用于BGA、CSP、覆晶等封装应用。 介面散热材料 介面散热材料分为有jel 材质(无黏性)与rubber材质(高黏性)，用作IC原件(device) 与散射片(heat spreader)之间的介质，可以提升散热功能。可广泛使用于封装 ...... | 2006年7月28日 | 626 |
| 5.验证方法学浅谈 --- 验证工具VHDL实例 简介:作者： deve 改善验证效率和可靠性的一个方法是自动化，自动化工具很多，有些是功能验证必不可少的，例如仿真器，有些工具可以代替人完成最繁琐的工作，并能提高功能验证的可信度，例如linting和代码覆盖率工具。 Linting tool &nbs ...... | 2006年7月27日 | 1212 |
| 6.验证方法学浅谈 --- 什么是验证VHDL实例 简介: 写在前面 验证的内涵和外延都非常大，常说的验证是指功能验证，占了大部分的工作量，因此大多数时候，人们往往把验证和功能验证等同使用，这里谈的主要也是功能验证。 验证对于IC设计、FPGA设计的重要性无须赘 ...... | 2006年7月27日 | 1611 |
| 7.什么是验证环境？ --- 验证的流程VHDL实例 简介:首先我们来解决第一个问题：什么是验证环境。在解释这个概念之前，讲解一下验证的流程是必须的。对很多人而言是老调重谈了。那么就可以略过这一节。 我们知道验 ...... | 2006年7月27日 | 1530 |
| 8.学写 Testbench --- 结构篇VHDL实例 简介:本章主要讲述Testbench的组织结构, 通过这些组织结构, 可以编写良好的测试文件.下边以示例性质的testbench.v文件进行讲解. testbench.v: ----------------------------------------------------- ...... | 2006年7月27日 | 2332 |
| 9.FPGA中双向端口的设计问题 简介: 在工程应用中,双向电路是设计者不得不面对的问题.在实际应用中,数据总线往往是双向的.如何正确处理数据总线是进行时序逻辑电路设计的基础.在程序设计过程中,关键技术在于:实体部分必须对端口属性进行申明,端口属性必须为inout类型,在构造体需要对输出信号进行有条件的高阻控制.在双向电路的处理问题上,常用的处理方式有两种,在介绍双向电路的处理方式之前,先看看双向电路的基本格式: ENTI ...... | 2006年7月27日 | 1405 |
| 10.和可靠性有关的几个概念 简介: 建立时间和保持时间 图 1 建立时间（setup time）是指在触发器的时钟信号上升沿到来以前，数据稳定不变的时间，如果建立时间不够，数据将不能在这个时钟上升沿被打入触发器;保持时间（hold time）是指在触发器的时钟信号上升沿到来以后，数据稳定不变的时间， 如果保持时间不够，数据同样不能被打入触发器。 如图 ...... | 2006年7月27日 | 1067 |
| 11.FPGA中的冒险现象 简介:信号在FPGA器件内部通过连线和逻辑单元时，都有一定的延时。延时的大小与连线的长短和逻辑单元的数目有关，同时还受器件的制造工艺、工作电压、温度等条件的影响。信号的高低电平转换也需要一定的过渡时间。由于存在这两方面因素，多路信号的电平值发生变化时，在信号变化的瞬间，组合逻辑的输出有先后顺序，并不是同时变化,往往会出现一些不正确的尖峰信号，这些尖峰信号称为"毛刺"。如果一个组合逻辑电路中有"毛刺"出现 ...... | 2006年7月27日 | 1294 |
| 12.关于时钟的讨论---3 简介: 5. 多时钟系统 许多系统要求在同一个PLD内采用多时钟。最常见的例子是两个异步微处理器器之间的接口，或微处理器和异步通信通道的接口。由于两个时钟信号之间要求一定的建立和保持时间，所以，上述应用引进了附加的定时约束条件。它们也会要求将某些异步信号同步化。 图11 给出一个多时钟系统的实例。CLK_A用以钟控REG_A，CLK_B用于钟控REG_B ...... | 2006年7月27日 | 1148 |
| 13.关于时钟的讨论---2 简介: 3．多级逻辑时钟 当产生门控时钟的组合逻辑超过一级(即超过单个的“与”门或“或”门)时，证设计项目的可靠性变得很困难。即使样机或仿真结果没有显示出静态险象，但实际上仍然可能存在着危险。通常，我们不应该用多级组合逻辑去钟控PLD设计中的触发器。 图7 给出一个含有险象的多级时钟的例子。时钟是由SEL引脚控制的多路选择器输出的。多路选择器的输入是时钟(CLK)和该时钟的 ...... | 2006年7月27日 | 1087 |
| 14.提高同步系统的运行速度 简介: 同步电路的速度是指同步时钟的速度。同步时钟愈快，电路处理数据的时间间隔越短，电路在单位时间处理的数据量就愈大。 我们先来看一看同步电路中数据传递的一个基本模型：如下图 图1 （Tco是触发器时钟到数据输出的延时;Tdelay是组合逻辑的延时;Tsetup是触发器的建立时间） 假设数据已经被时钟的上升沿打入D触发器，那么数据到达第一个触发器的Q ...... | 2006年7月27日 | 945 |
| 15.assura RCX 简介(转） 简介: FOUNDRY选用的是TSMC 0.18UM MIX-SIGNLE ,ASSURA VERSION --3.12 先建立一个assura techfile directury，把所有foundry提供的assura文件都放进去。在你运行icfb&的路径下，建立一个*.lib文件，这是一个类似cds.lib的文件，他将定义一个technology,并指向建好的assura techfile ...... | 2006年7月27日 | 1235 |
| 16.用MAX＋PLUSⅡ开发Altera CPLD 简介: 用MAX＋PLUSⅡ开发Altera CPLD 桂林师范高等专科学校数学与计算机系 （桂林541001） 邹于丰 【 摘 要 】介绍利用MAX＋PLUSⅡ软件对Altera公司的CPLD进行图形设计、编译以及在系统编程的基本方法和步骤。 【 关键词 】 MAX＋PLUSⅡ ...... | 2006年7月27日 | 1865 |
| 17.[转载]基于CPLD和接触式图像传感器的图像采集系统 简介: 基于CPLD和接触式图像传感器的图像采集系统 长沙理工大学 贺科学 李鸿 接触式图像传感器CIS（Contact Image Sensor）是继CCD之后于20世纪90年代研究和开发的一种新型光电耦合器件[1]。它将光电传感阵列、LED光源阵列、柱状透镜阵列、移位寄存器和模拟开关等集成在一个条状方形盒内，其工作原理与CCD较为相似，但与CCD相比 ...... | 2006年7月27日 | 932 |
| 18.视频分配器中提高信号完整性的方法 简介: 作者：北京交通大学 机械与电子控制工程学院 韩淑霞 张励忠 荆涛 尹航 王文杰 摘 要 ：本文通过对信号完整性问题产生机理的分析，提出了一系列的解决方案。针对一个小型的VGA分配器的设计，结合合理的仿真模型说明了确保良好信号完整性是高速电子系统实现的保证。 引言 处理高速电子系统的信号完 ...... | 2006年7月27日 | 1412 |
| 19.确定磁芯B-H回路特性的虚拟仪器 简介: 确定磁芯B-H回路特性的虚拟仪器 在设计含磁芯材料的电感元件时，工程师必须准确测出该材料的特性。磁芯的动态磁滞回路（或B-H曲线）包含了有关磁芯损耗和其它磁参数的有价值信息。不幸的是，商用的磁回路分析仪都很昂贵，不适合小规模研究实验室和制造商使用。本设计实例描述了一个虚拟仪器，它采用一台台式或笔记本计算机，结合一个模拟数据采集卡和Nat ...... | 2006年7月27日 | 1139 |
| 20.基于梯形图-VHDL的CPLD开发方法研究 简介: 作者：武汉工业学院 电气信息工程系 肖忠 摘 要 ：本文对直接采用CPLD器件设计顺序控制逻辑电路时设计效率不高的问题进行了分析，提出了将梯形图工具与VHDL程序相结合的设计方法以提高设计效率，并研究了用VHDL语言实现梯形图的方法。设计实例证明，这种基于梯形图的VHDL设计方法正确可行，可以提高设计效率。 引言 顺序控制逻辑电 ...... | 2006年7月27日 | 926 |
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