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 ――――DDRII总线静态时序分析报告
上海佳研仿真设计工作室期刊八 

                       ――――DDRII总线静态时序分析报告 

   本文以一个实际的项目为背景，对该项目中MPC8568的DDRII接口进行静态时序分析，用于评估该接口的时序情况，指导PCB设计。本文阐述的是静态时序分析方法，主要是讲解整个DDRII接口时序分析的原理及简单的时序分析计算过程，这种方法适用于一般的接口时序分析，也是工程上最常见的分析方法。DDRII接口属于源同步时序，静态时序计算的公式可以简单的理解为：时序余量等于驱动芯片的输出有效窗口减去接收端芯片的输入有效窗口。当然在计算的过程中还要考虑串扰，ISI，SSN，走线不匹配等因素。这些因素理论上要通过严格的仿真分析得到，不过本文是静态时序计算，因此就简单的根据仿真经验评估这些因素。详细情况请看附件中的期刊，谢谢您的关注!

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发表时间:2009年7月13日22:26:21